AD6649

新規設計に推奨

IFダイバーシティ･レシーバ

データシート (Rev. D) 製品セレクション・テーブル
製品モデル
2
1Ku当たりの価格
最低価格：$98.04
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
Viewing:

製品の詳細

  • SNR＝73.0dBFS（95MHz 帯域幅）＠AIN＝185MHz、245.76MSPS
  • SFDR＝85dBc＠AIN＝185MHz、＠250MSPS
  • 入力ノイズ：－151.2dBFS/Hz＠220MHz、－1dBFS・AIN、250MSPS
  • 総合消費電力：1W
  • 1.8VのアナログとLVDS出力電源で動作
  • 入力クロック分周器（インテジャー1～8分周）を集積（最大625MHz入力）
  • デュアル・チャンネルのADCを内蔵
    -- 最大サンプル・レート：250MSPS
    -- IFサンプリング周波数：400MHzまで
  • ワイドバンド・デジタル・ダウンコンバータ（DDC）を内蔵
    -- 32ビットコンプレックス、数値制御発振器（NCO）
    -- 2つのモードを持ったサンプル・レート・コンバータとFIRフィルタ
    -- fs/4出力NCOからのリアル出力
  • 効率の良いAGC導入のための高速検出ビット
  • 省電力のパワーダウン・モード
  • デシメートされたインターリーブの「リアル」LVDSデータ出力

    詳細はデータシートをご参照ください。
AD6649
IFダイバーシティ･レシーバ
AD6649 Functional Block Diagram AD6649-pc
myAnalogに追加

myAnalogの製品セクション（通知受け取り）、既存／新規プロジェクトに製品を追加する。

新規プロジェクトを作成
質問する
サポート

アナログ・デバイセズのサポート・ページはアナログ・デバイセズへのあらゆるご質問にお答えするワンストップ・ポータルです。

ドキュメント

データシート 1

ユーザ・ガイド 1

アプリケーション・ノート 16

評価用設計ファイル 3

さらに詳しく
myAnalogに追加

myAnalogの製品セクション（通知受け取り）、既存／新規プロジェクトに製品を追加する。

新規プロジェクトを作成

ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
クロック生成デバイス 6
AD9510
新規設計に推奨 クロック分配器、1.2 GHz、PLL内蔵、分周器内蔵、遅延調整、8出力
AD9511
新規設計に推奨 クロック分配器、800MHz、PLL内蔵、分周器内蔵、遅延調整、5出力
AD9512
新規設計に推奨 クロック分配IC、1.2GHz、2つの1.6GHz入力、分周器／遅延調整内蔵、5出力
AD9523
新規設計には非推奨 クロック・ジェネレータ、14出力、低ジッタ
AD9523-1
新規設計に推奨 クロック生成器、低ジッタ、14LVPECL/LVDS/HSTL/29LVCMOS出力
AD9524
新規設計には非推奨 クロック・ジェネレータ、6出力、デュアル・ループ
クロック分配器 （クロック・ディストリビューション） 3
AD9513
新規設計に推奨 クロック分配IC、800 MHz、分周機能、遅延調整機能、3出力
AD9514
新規設計に推奨 クロック分配IC、1.6GHz、分周器、遅延調整、3出力
AD9515
新規設計に推奨 1.6 GHZクロック分配IC、ドライバ、遅延調整、2出力
シングルエンド入力差動出力アンプ 2
ADA4927-2
新規設計に推奨 差動アンプ、ADC ドライバ、超低歪み、電流帰還型
ADA4938-2
新規設計に推奨 ADCドライバ、差動、超低歪み、デュアル
デジタル制御VGA 2
ADL5202
製造中止 VGA（可変ゲイン・アンプ）、デジタル制御、広ダイナミック範囲、高速
AD8376
新規設計に推奨 VGA、デュアル、超低歪
完全差動アンプ 1
ADL5562
新規設計に推奨 RF/IF用差動アンプ、超低歪み、3.3 GHz
Modal heading
myAnalogに追加

myAnalogの製品セクション（通知受け取り）、既存／新規プロジェクトに製品を追加する。

新規プロジェクトを作成

ツールおよびシミュレーション

Virtual Eval（仮想評価、 ベータ版）

Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。

ツールを開く

AD6649 IBIS Model 1

Visual Analog

VisualAnalog™は、高速ADCの選択や評価を行う設計者向けに、強力なシミュレーション／データ解析ツール・セットとユーザ・フレンドリなグラフィカル・インターフェースを組み合わせたソフトウェア・パッケージです。

ツールを開く

ADIsimRF

ADIsimRFは使いやすいRFシグナル・チェーン計算ツールです。最大50段までのシグナル・チェーンについて、カスケード・ゲイン、ノイズ、歪み、消費電力を計算し、プロット、エクスポートが可能です。ADIsimRFには、アナログ・デバイセズのRFおよびミックスド・シグナル部品のデバイス・モデルの広範なデータ・ベースも含まれています。

ツールを開く

Sパラメータ 1

評価用キット

eval board
schematic 1
schematic 2
schematic 3
EVAL-AD6649

AD6649 Evaluation Board

今すぐ購入 詳細を表示

機能と利点

  • Full featured evaluation board for the AD6649
  • SPI interface for setup and control
  • External or AD9523 clocking option
  • Balun/transformer or amplifier input drive options
  • LDO regulator power supply
  • VisualAnalog and SPI controller software interfaces

製品詳細

The AD6649EBZ is an evaluation board for the AD6649, dual 14-bit mixed-signal IF receiver ADC. This reference design provides all of the support circuitry to operate devices in their various modes and configurations, It is designed to interface directly with the HSC-ADC-EVALCZ data capture card, allowing users to download captured data for analysis. The Visual Analog software package, which is used to interface with the device’s hardware, allows users to download captured data for analysis with a user-friendly graphical interface. The SPI controller software package is also compatible with this hardware and allows the user to access the SPI programmable features of the AD6649.

The AD6649 data sheet provides additional information related to device configuration and performance and should be consulted when using these tools. All documents and Visual Analog and SPI Controller are available at the High Speed ADC Evaluation Boards page. For additional information or questions, please email highspeed.converters@analog.com.

eval board
schematic 4
HSC-ADC-EVALCZ

FPGAベースのデータ・キャプチャ・キット

今すぐ購入 詳細を表示

機能と利点

  • FIFO深さ：64kB
  • シングル/マルチ・チャンネルADCで動作
  • VisualAnalog® ソフトウェアで使用
  • Virtex-4 FPGAベースのキット
  • ADCの評価ボードによってはインターフェース用のアダプタが必要になる場合があります。
  • 各チャンネルによりSPI制御 最大644 MSPS SDR / 800MSPS DDRのエンコード・レートでのプログラムが可能
  • 各チャンネルはDDRのエンコード・レート

製品詳細

HSC-ADC-EVALCZ 高速コンバータ評価用プラットフォームは、アナログ・デバイセズの高速 A/D コンバータ（ADC）評価用ボードからのデジタル・データのブロックをキャプチャする FPGA ベースのバッファ・メモリ・ボードを使用しています。このボードは、USB ポートを介して PC に接続し、VisualAnalog® とともに使用して、高速 ADC の性能を短時間で評価します。この評価用キットはセットアップが容易です。その他の必要な装置には、アナログ・デバイセズの高速 ADC 評価用ボード、信号源、クロック源などがあります。キットを接続して電源を投入すると、PC で即座に評価することができます。

EVAL-AD6649
AD6649 Evaluation Board
AD9643-250EBZ Evaluation Board AD9643-250EBZ Evaluation Board - Top View AD9643-250EBZ Evaluation Board - Bottom View
HSC-ADC-EVALCZ
FPGAベースのデータ・キャプチャ・キット
High_Speed_ADC_evalboard_05

最新のディスカッション

1 年前
RE: AD6649 restoring the IQ signal
EngineerZone®で関連するディスカッションを見る

最近表示した製品