AD9511
新規設計に推奨クロック分配器、800MHz、PLL内蔵、分周器内蔵、遅延調整、5出力
- 製品モデル
- 2
- 1Ku当たりの価格
- 最低価格:$8.72
製品の詳細
- 低位相ノイズの位相ロック・ループ(PLL)コア
- リファレンス入力周波数:最大250MHz
- プログラマブル・デュアル・モジュール・プリスケーラ
- プログラマブル・チャージ・ポンプ電流(CP)
- 別々のCP電源(VCP)のチューニング・レンジを拡張可能
- 2つの1.6GHz、差動クロック入力
- 5つのプログラマブル分周器、1~32のすべての整数に対応
- 出力/出力の遅延粗調整による位相選択
- 3つの独立した1.2GHz LVPECL出力:
- 出力増加ジッタ:225fs rms
- 2つの独立した800MHz/250MHz LVDS/CMOS出力:
- 出力増加ジッタ:275fs rms
- 1つの出力は5ビットの遅延ワードで微調整可能
- シリアル・コントロール・ポート
- 小型48ピンLFCSPパッケージ
AD9511は内蔵PLLコアを用いて、複数個のクロック分配機能を提供します。この製品は、データ・コンバータの性能を最大限に引き出すために、低ジッタと低位相ノイズに重点を置いて設計されています。位相ノイズ条件やジッタ条件の厳しい他のアプリケーションもこのデバイスの利点を活用できます。
PLLのブロックは、プログラマブル・リファレンス・デバイダR、低ノイズ位相周波数検出器PFD、高精度チャージ・ポンプCPとプログラマブル・フィードバック・デバイダNで構成されています。外付けのVCXOまたはVCOをCLK2とCLK2Bピンに接続することによって、PLL出力周波数は最大1.6GHzまで入力リファレンスREFINに同期させることができます。
5つの独立したクロック出力が備わっています。3つの出力はLVPECL(1.2GHz)で、他の2つはLVDS(800MHz)レベルまたはCMOS(250MHz)レベルを選択できます。
1つのクロック出力の別のクロック出力を基準とした位相は、粗タイミング調整として機能する分周期位相選択機能により、変動する可能性があります。LVDS/CMOS出力の1つは、遅延のフルスケール範囲が最大10nsのプログラマブル遅延エレメントを備えています。この微調整遅延ブロックは5ビットの分解能で、各フルスケール設定に対し32通りの遅延が可能です。
AD9511は、コンバータの最高性能がサブピコ秒のジッタのエンコード信号で実現される、データ・コンバータ・クロッキング・アプリケーションに最適です。
AD9511は48ピンLFCSPパッケージで提供され、3.3V単電源で動作可能です。外部VCOを用いる場合、電圧範囲の拡大が必要となりますが、チャージ・ポンプ電源(VCP)を5.5Vに接続することでこれに対処できます。温度範囲は−40℃~+85℃です。
アプリケーション
ドキュメント
データシート 1
アプリケーション・ノート 10
技術記事 6
評価用設計ファイル 2
リファレンス設計 1
ウェブキャスト 1
製品選択ガイド 1
Analog Dialogue 1
製品モデル | ピン/パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
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AD9511BCPZ | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) | ||
AD9511BCPZ-REEL7 | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) |
製品モデル | 製品ライフサイクル | PCN |
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6 9, 2021 - 20_0126 Conversion of Select Sizes LFCSP Products from Punched to Sawn and Transfer of Assembly Site to ASE Korea |
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AD9511BCPZ | 製造中 | |
AD9511BCPZ-REEL7 | 製造中 | |
9 13, 2017 - 16_0077 CANCELLED: Conversion of Select 4x4, 5x5, 6x6 and 7x7mm LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to ASE Korea. |
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AD9511BCPZ | 製造中 | |
AD9511BCPZ-REEL7 | 製造中 |
これは最新改訂バージョンのデータシートです。
ハードウェア・エコシステム
ツールおよびシミュレーション
AD9511 IBIS Models 1
ADIsimCLK 設計・評価 ソフトウェア
ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE(自動試験装置)あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。
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