AD9863

新規設計には非推奨

ミックスド・シグナル・フロントエンド（MxFE™）ベースバンド・トランシーバ、ブロードバンド・アプリケーション向け

データシート (Rev. B) 製品セレクション・テーブル
製品モデル
2
1Ku当たりの価格
最低価格：$31.55
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
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製品の詳細

  • 受信経路には内部又は外部リファレンスを備えた50MSPSバージョンのデュアル12ビットA/Dコンバータが内蔵されています。
  • 送信経路には1x、2x又は4xインターポレーションとプログラマブル・ゲイン制御を備えたデュアル12ビット、200MSPSD/Aコンバータが内蔵されています。
  • 内部クロック分配回路にはプログラマブル・フェーズ・ロック・ループとタイミング発生回路が含まれており、単一のリファレンス・クロック動作が可能です。
  • 柔軟な24ビットI/Oデータ・インターフェースにより、半二重モードで各種のインターリーブ又は非インターリーブ・データの転送を、そして全二重モードではインターリーブ・データの転送を可能にします。
  • 抵抗による設定あるいはオプションのモードピンを使用した限定設定を介して設定可能
  • RxとTxの別々のパワーダウン制御ピン
  • 64ピンLFCSPパッケージ（9 mm×9 mmフットプリント）
AD9863
ミックスド・シグナル・フロントエンド（MxFE™）ベースバンド・トランシーバ、ブロードバンド・アプリケーション向け
AD9863-fbl 894062479AD9863-pc AD9863 Pin Configuration
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ドキュメント

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アプリケーション・ノート 3

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ツールおよびシミュレーション

AD9863 IBIS Models 1

評価用キット

eval board
schematic 1
AD-DAC-FMC

AD-DAC-FMC-ADP

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製品詳細

AD-DAC-FMC-ADPアダプター・ボードによりアナログ・デバイセズ社のいずれのDPG2互換高速DAC評価用ボードも Xilinx®評価用ボード上でFMC コネクタで接続して使用できます。アダプタ・ボードはFMCコネクタの少ピン数(LPC) バージョンを採用しているので、LPCホスト 又は HPCホスト（ ML605 又は SP605など）上で使用できます。
互換評価用ボードの一覧表については当社のData Pattern Generator (DPG) High-Speed DAC Evaluation Platformページの"DPG2"情報をご覧ください。

AD-DAC-FMC
AD-DAC-FMC-ADP
EVAL-AD9861
AD9861/AD9863 Evaluation Tools

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