AD9144
新規設計に推奨D/Aコンバータ、クワッド、16ビット、2.8GSPS、TxDAC+®
- 製品モデル
- 4
- 1Ku当たりの価格
- 最低価格:$102.72
製品の詳細
- 1GSPS以上の入力データレートをサポート
- 低スプリアスおよび低歪みの独自設計
- 6キャリアGSM IMD=77dBc@75MHz IF
- SFDR = 82 dBc@dc IF、−9 dBFS
- 柔軟な8レーンJESD204Bインターフェース
- 2.8GSPSでクワッド/デュアルDACモードをサポート
- 複数チップの同期
- 固定遅延
- データ生成遅延の補正
- 1×、2×、4×、8× インターポレーション・フィルタが選択可能
- 低消費電力アーキテクチャ
- 入力信号パワー検出
- ダウンストリームのアナログ回路の保護のための緊急停止
- 消費電力をさらに削減する送信イネーブル機能
- 高性能、低ノイズのPLLクロック逓倍器
- デジタル反転SINCフィルタ
- 低消費電力:1.6 W@1.6 GSPS、1.7 W@2.0 GSPS、完全動作状態
- 露出パッド付き88ピンLFCSP
AD9144はクワッド、16ビット、高ダイナミックレンジのD/Aコンバータ(DAC)で、サンプル・レートが最高2.8GSPSなのでナイキスト周波数までのマルチキャリア生成を可能にします。DAC出力は、アナログ・デバイセズのアナログ直交変調器(AQMs)ADRF6720とシームレスにインターフェースできるように最適化されています。3線あるいは4線に選択可能なシリアル・ポート・インターフェース(SPI)は、多くの内部パラメータのプログラミング/リードバックに使われます。フルスケール出力電流は、13.9mA~27.0mA(typ)の範囲で設定できます。AD9144は88ピンLFCSPパッケージを採用しています。
製品のハイライト
- 1GHz以上の非常に広い複素信号帯域幅は最新の広帯域マルチバンドのワイヤレス・アプリケーションを可能にします。
- 高度な低スプリアスおよび低歪みの設計技術により、ベースバンドから高中間周波数までの広帯域信号の高品質な合成が可能です。
- JESD204Bサブクラス1の支援により、ハードウェア設計およびソフトウェア設計で複数チップの同期が簡素化されます。
- シリアライザ/ディシリアライザ(SERDES)のJESD204Bに準拠した8レーンインターフェース使用のデータ・インターフェース幅でピン数が少ない。
- プログラマブルな送信イネーブル機能を使うと、消費電力とウェークアップ時間との間のバランスを容易に設計できます。
- 12mm×12mmフットプリントの小型パッケージ・サイズ
アプリケーション
- ワイヤレス通信
3G/4G W-CDMA基地局
広帯域リピーター
ソフトウェア定義無線ワイヤレス - 広帯域通信
ポイントtoポイント
ローカル・マルチポイント・ディストリビューション・サービス(LMDS)/マルチチャンネル・マルチポイント・ディストリビューション・サービス(MMDS) - ダイバーシティ送信、複数入力/複数出力(MIMO)
- 計測機器
- 自動テスト装置
ドキュメント
データシート 2
ユーザ・ガイド 1
技術記事 1
情報 1
ビデオ 2
デバイス・ドライバ 1
FPGA相互運用性レポート 2
製品モデル | ピン/パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
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AD9144BCPAZ | 88-Lead LFCSP (12mm x 12mm w/ EP) | ||
AD9144BCPAZRL | 88-Lead LFCSP (12mm x 12mm w/ EP) | ||
AD9144BCPZ | 88-Lead LFCSP (12mm x 12mm w/ EP) | ||
AD9144BCPZRL | 88-Lead LFCSP (12mm x 12mm w/ EP) |
製品モデル | 製品ライフサイクル | PCN |
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6 26, 2023 - 23_0025 Package Outline Drawing and Data Sheet Revision for Select LFCSP Products in Amkor |
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AD9144BCPAZ | 製造中 | |
AD9144BCPAZRL | 製造中 | |
AD9144BCPZ | 製造中 | |
AD9144BCPZRL | 製造中 | |
8 31, 2016 - 16_0159 AD9144 Die Revision and Data Sheet Update |
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AD9144BCPAZ | 製造中 | |
AD9144BCPAZRL | 製造中 | |
AD9144BCPZ | 製造中 | |
AD9144BCPZRL | 製造中 | |
4 2, 2015 - 15_0055 AD9144 Die Revision and Data Sheet Update |
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AD9144BCPZ | 製造中 | |
AD9144BCPZRL | 製造中 |
これは最新改訂バージョンのデータシートです。
ソフトウェア・リソース
デバイス・ドライバ 1
評価用ソフトウェア 2
JESD204 Interface Framework
Integrated JESD204 software framework for rapid system-level development and optimization
JESD204x Frame Mapping Table Generator
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
必要なソフトウェア/ドライバが見つかりませんか?
ハードウェア・エコシステム
製品モデル | 製品ライフサイクル | 詳細 |
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クロック生成デバイス 2 | ||
LTC6952 | 最終販売 | 11 の出力を備えた、JESD204B/JESD204C をサポートする超低ジッタ 4.5 GHz PLL |
HMC7044 | 新規設計に推奨 |
JESD204B / JESD204 用機能付き、3.2 GHz、14 出力、高性能ジッター減衰器 |
クロック分配器 (クロック・ディストリビューション) 3 | ||
LTC6955 | 最終販売 | 超低ジッタ、7.5 GHz、11 出力ファンアウト・バッファ・ファミリー |
LTC6953 | 最終販売 | 11 の出力を備えた、JESD204B/JESD204C をサポートする超低ジッタ 4.5 GHz クロック分配器 |
HMC7043 | 新規設計に推奨 |
JESD204B/JESD204C 用機能付き、3.2 GHz、14 出力、高性能ファンアウト・バッファ |
ツールおよびシミュレーション
Virtual Eval(仮想評価、 ベータ版)
Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。
ツールを開くIBISモデル 1
AD9144/AD9152/AD9154/AD9135/AD9136 AMI Model Download
ツールを開くAD9144 Simulink ADIsimDAC Model
ツールを開くDAC Companion Transport Layer RTL Code Generator
These command line executable tool generates a Verilog module which implements the JESD204 transmitter transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
ツールを開く
LTspice®は、無料で提供される強力で高速な回路シミュレータと回路図入力、波形ビューワに改善を加え、アナログ回路のシミュレーションを容易にするためのモデルを搭載しています。