AD9546
新規設計に推奨デュアルDPLLデジタル化クロック・シンクロナイザ
- 製品モデル
- 2
- 1Ku当たりの価格
- 最低価格:$19.25
製品の詳細
- デジタル化クロック伝送サブシステム
- 9個の独立したUTSブロック(タイム・スタンプ出口ポート)
- 2個の独立したIUTSブロック(タイム・スタンプ入口ポート)
- デュアルDPLLは1Hz〜750MHzの物理層クロックを同期し、ノイズの多いリファレンスのジッタ・クリーニングで周波数を変換
- ITU-T G.8262とTelcordia GR-253に準拠
- Telcordia GR-1244、ITU-T G.812、ITU-T G.813、ITU-T G.823、ITU-T G.824、ITU-T G.825、ITU-T G.8273.2をサポート
- 最小50ppb(5 × 10−8)の周波数偏差を実現する連続的な周波数モニタリングとリファレンス検証
- DPLLはいずれも24ビットのプログラマブル係数による24ビット・フラクショナル分周器を実装
- プログラマブルなデジタル・ループ・フィルタ帯域幅:0.0001Hz~1850Hz
- PTPアプリケーションにおけるIEEE-1588バージョン2のサーボ・フィードバックに適した、2つの独立したプログラマブル補助NCO(1Hz~65,535Hz、分解能:1.37pHz未満)
- ゼロ遅延、ヒットレス、位相ビルドアウトなどの動作を提供する自動および手動のホールドオーバーとリファレンス・スイッチオーバー
- プログラマブルな優先度をベースにしたリファレンス・スイッチング(手動、自動復帰、自動非復帰モードをサポート)
- 5ペアのクロック出力ピン。各ペアを差動LVDS/HCSL/CMLまたは2つのシングルエンド出力(1Hz~500MHz)として使用可能
- 2つの差動入力リファレンス、または8つのシングルエンド入力リファレンス
- クロスポイント・マルチプレクサによりリファレンス入力をPLLに接続
- 埋め込み(変調)入出力クロック信号をサポート
- 高速DPLLロック・モード
- 水晶共振器または水晶発振器の低位相ノイズとTCXOまたはOCXOの周波数安定性および精度を組み合わせる機能を内蔵
- 自律初期化における外部EEPROMのサポート
- 内部レギュレータによる1.8Vの単電源動作
- ゼロ遅延性能向上のための内蔵温度モニタおよびアラームと温度補償
AD9546には、システム内でクロック信号を効率的に伝送および分散させるデジタル化されたクロッキング技術が組み込まれています。デジタル化されたクロッキングにより、位相(時刻)アライメントが適切に制御された柔軟でスケーラブルなクロック伝送システムの設計が可能になります。これらの特性により、AD9546は、ITU-T G.8273.2 Class Dに従ったIEEE® 1588™境界クロックの同期要件を満たす必要があるネットワーク機器の設計に最適な選択肢となります。デジタル化されたクロッキングは、複数の使用ポイントに対する周波数および位相の正確な伝送(例えば、ADCチャンネルの配列に対する同期システム・リファレンス(SYSREF)クロックの分散など)が必要なアプリケーションにも関連しています。
AD9546は、サービス・プロバイダ・パケット・ネットワーク上での周波数、位相、および時刻の配信に関する国際電気通信連合(ITU)の既存の標準と新しい標準をサポートしています(ITU-T G.8262、ITU-T G.812、ITU-T G.813、ITU-T G.823、ITU-T G.824、ITU-T G.825、ITU-T G.8273.2など)。
AD9546の10個のクロック出力は、最大で8つの入力リファレンスのいずれか1つに同期しています。デジタル・フェーズ・ロック・ループ(DPLL)は、外部リファレンスに関係するタイミング・ジッタを低減します。アナログ・フェーズロック・ループ(APLL)は、低いジッタ出力クロックで周波数変換を行います。すべてのリファレンス入力が使用できなくなった場合でも、デジタル制御されたループおよびホールドオーバー回路が、低ジッタの出力信号を引き続き生成します。
AD9546は、48ピンLFCSP(7 mm × 7 mm)パッケージで提供され、−40°C~+85°Cの温度範囲で動作します。
このデータシートでは、多機能ピン名の1つの機能のみ関連している場合(SDO/M5用M5)は、その機能にのみ言及していることがあります。
アプリケーション
- 5Gタイミング伝送高精度同期
- GPS(全地球測位システム)、PTP(Precision Time Protocol)(IEEE 1588)、同期イーサネット(SyncE)ジッタ・クリーンアップおよび同期
- 光伝送網(OTN)、同期デジタル階層(SDH)、マクロ・セルおよびスモール・セル基地局、小型基地局のクロック(ベースバンドおよび無線)
- Stratum 2、Stratum 3e、Stratum 3ホールドオーバー、ジッタ・クリーンアップ、および位相トランジェント制御
- A/Dコンバータ(ADC)およびD/Aコンバータ(DAC)のクロック駆動におけるJESD204Bのサポート
- キャリア・イーサネット
ドキュメント
データシート 2
ユーザ・ガイド 2
ビデオ 1
製品選択ガイド 1
製品モデル | ピン/パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
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AD9546BCPZ | 48-Lead LFCSP (7mm x 7mm x 0.75mm w/ EP) | ||
AD9546BCPZ-REEL7 | 48-Lead LFCSP (7mm x 7mm x 0.75mm w/ EP) |
製品モデル | 製品ライフサイクル | PCN |
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8 8, 2022 - 22_0065 Data Sheet Revision for AD9543/AD9545/AD9546 |
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AD9546BCPZ | 製造中 | |
AD9546BCPZ-REEL7 | 製造中 |
これは最新改訂バージョンのデータシートです。
ハードウェア・エコシステム
製品モデル | 製品ライフサイクル | 詳細 |
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AD9545 | 新規設計に推奨 | IEEE1588 バージョン 2 および 1 pps シンクロナイザおよび適応型クロック変換器 |