AN-1364: 通信系统中接收链的差分滤波器设计

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简介

RF工程师在设计中常常会看到单端50 Ω系统。某些人认为，差分电路很难设计、测试和调试。另一方面，为了提高性能，通信系统常常要应用差分系统，尤其是IF级中。在这些困难中，差分滤波器是一个关键问题。本应用笔记介绍基本滤波器的一些重要规格概念、几类常用滤波器的响应和切比雪夫1型滤波器应用，并且逐步说明如何将单端滤波器设计转化为差分滤波器设计。本应用笔记提供了一个差分滤波器设计示例，并讨论了关于如何优化差分电路PCB设计的若干要点。

差分电路优点

本部分讨论RF信号链应用中差分电路相对于单端电路的优点。

用户利用差分电路可以达到比利用单端电路更高的信号幅度。在相同电源电压下，差分信号可提供两倍于单端信号的幅度，以及更好的线性度和SNR性能。

Figure 1. Differential Output Amplitude.
图1. 差分输出幅度

差分电路对外部EMI和附近信号的串扰具有很好的抗扰性。这是因为接收电压加倍，噪声对紧密耦合走线的影响在理论上是相同的，因而它们彼此抵消。

差分信号产生的EMI往往也较低。这是因为信号电平的变化(dV/dt或dI/dt)产生相反的磁场，再次相互抵消。

差分信号可抑制偶数阶谐波。例如，让连续波(CW)通过一个增益级。

若使用一个单端放大器，如图2所示，输出可表示为公式1和公式2。

Figure 2. Single-Ended Amplifier.

图2. 单端放大器

Equation 01-02

其中…表示该序列一直进行下去。

若使用一个差分放大器，则输入和输出如图3所示，表示为公式3、公式4、公式5和公式6。

Figure 3. Differential Amplifier.
图3. 差分放大器

Equation 03-06

其中…表示该序列一直进行下去。

理想情况下，输出没有任何偶数阶谐波。

因此，在通信系统中，为了实现更好的性能，差分电路是首选。

滤波器

滤波器规格


截止频率、转折频率或拐点频率是系统频率响应的边界，此时流经系统的能量开始减少(衰减或反射)，而不是自由通过。

Figure 4. 3 dB Cutoff Frequency Point.
图4. 3 dB截止频率点

带内纹波指通带内插入损耗的波动。

Figure 5. In-Band Ripple.
图5. 带内纹波

相位线性度指相移与目标频率范围内的频率成比例的程度。

Figure 6. Phase Linearity.
图6. 相位线性度

群延迟衡量一个穿过受测器件的信号的各种正弦成分幅度包络的时间延迟，它与各成分的频率相关。

Figure 7. Group Delay.
图7. 群延迟

滤波器比较


表1. 滤波器比较
滤波器 S21响应 优点 缺点/td>
巴特沃兹 参见图8 通带内的平坦度非常好 阻带内缓慢滚降
椭圆 参见图9 接近阻带时滚降非常迅速 通带和阻带中均有均衡纹波，这会影响阻带抑制性能
贝塞尔 参见图10 最平坦的群/相位延迟 阻带内滚降非常缓慢
切比雪夫I型 参见图11 阻带内滚降非常迅速；阻带内无均衡纹波 通带内有均衡纹波
切比雪夫II型 参见图12 通带内无纹波 滚降不是非常快；阻带内有均衡纹波
Figure 8. Butterworth Filter S21 Response.
图8. 巴特沃兹滤波器S21响应
Figure 9. Elliptiv Filter S21 Response.
图9. 椭圆滤波器S21响应
Figure 10. Bessel Filter S21 Response.
图10. 贝塞尔滤波器S21响应
Figure 11. Chebyshev Type I Filter S21 Response.
图11. 切比雪夫I型滤波器S21响应
Figure 12. Chebyshev Type II Filter S21 Response.
图12. 切比雪夫II型滤波器S21响应

通信接收链中设计的IF滤波器基本上是低通滤波器或带通滤波器，用于抑制混叠信号以及有源器件产生的杂散。这些杂散包括谐波和IMD产物等成分。利用该滤波器，接收链可提供干净且具有良好SNR的信号供ADC分析。

切比雪夫I型滤波器具有良好的带内平坦度，阻带内滚降迅速且无均衡纹波，因而选择它作为拓扑结构。

低通滤波器设计

接收IF滤波器用于抑制杂散和混叠信号，因此阻带滚降越快越好，但更快的滚降意味着要使用更高阶器件。尽管如此，但不推荐使用高阶滤波器，原因如下：

  • 在设计和调试阶段调谐困难。
  • 量产困难，因为电容间和电感间存在差异，各PCB上的滤波器难以具有相同的响应。
  • PCB尺寸较大。

一般使用七阶或更低阶的滤波器。另一方面，当器件的阶数相同时，若更大的带内纹波不是问题，则更快的阻带滚降就是一笔开销。

所需的响应通过指定选定频率点需要的衰减来定义。

为了确定通带中的最大纹波量，应使该规格等于系统要求的最大限值，这样有助于获得更快的阻带滚降。

使用低成本滤波器软件，如MathCad®、MATLAB®或ADS来设计单端低通滤波器。

或者手动设计滤波器。Chris Bowick所著《RF电路设计》提供了很有用的指南。

为了确定滤波器的阶数，应将目标频率除以滤波器的截止频率，使其归一化。

Equation 07

例如，若要求带内纹波为0.1 dB，则3 dB截止频率为100 MHz。在250 MHz时，要求抑制性能为28 dB，频率比为2.5。三阶低通滤波器可满足这一要求。如果滤波器的源阻抗为200 Ω，滤波器的负载阻抗也是200 Ω，则RS/RL为1；使用电容作为第一元件。这样用户获得归一化的C1 = 1.433，L2 = 1.594，C3 = 1.433；fc 为100 MHz，使用公式7和公式8获得最终结果：

Equation 08-09

其中：

CSCALED为最终电容值。
LSCALED 为最终电感值。
Cn 为低通原型元件值。
Ln为低通原型元件值。
RL为最终负载电阻值。
fc为最终截止频率。

C1SCALED = 1.433/(2π × 100 × 106 × 200) = 11.4 pF

L2SCALED = (1.594 × 200)/(2π × 100 × 106) = 507.4 nH

C3SCALED = 11.4 pF

电路如图13所示。

Figure 13. Single-Ended Filter Example.
图13. 单端滤波器示例

将单端滤波器转化为差分滤波器(参见图14)。

Figure 14. Converting Single-Ended Filter into Differential Filter.
图14. 单端滤波器转化为差分滤波器

对各元件使用实际值，更新后的滤波器如图15所示。

Figure 15. Final Differential Filter.
图15. 最终差分滤波器

注意，如果混频器或IF放大器的输出阻抗以及ADC的输入阻抗为容性，则考虑使用电容作为第一元件和最后元件会更好。另外，第一电容和最后电容的容值调谐速率(至少0.5 pF)必须高于混频器或IF放大器的输出阻抗以及ADC输入阻抗的容值。否则，调谐滤波器响应将非常困难。

带通滤波器设计

在通信系统中，当IF频率相当高时，某些低频杂散也需要滤除，例如半IF杂散。对于此类应用，应设计带通滤波器。对于带通滤波器，低频抑制和高频抑制不必对称。设计带通抗混叠滤波器的简单方法是先设计一个低通滤波器，然后在滤波器最后一级的分流电容上并联一个分流电感，用以限制低频成分(分流电感是一个高通谐振极点)。如果一级高通电感还不够，可在第一级分流电容上再并联一个分流电感，从而更好地抑制低频杂散。增加分流电感之后，再次调谐所有元件以获得正确的带外抑制规格，然后最终确定滤波器元件值。

注意，对于带通滤波器，一般不建议使用串联电容，因为这会增加调谐和调试的难度。电容值通常相当小，会受到寄生电容很大的影响。

应用示例

本部分说明一个位于ADL5201和AD6641之间的滤波器设计应用示例。ADL5201是一款高性能IF数字控制增益放大器(DGA)，针对基站实IF接收机应用或数字预失真(DPD)观测路径而设计，具有30 dB增益控制范围，线性度极高，OIP3 达到50 dBm，电压增益约为20 dB。 AD6641是一款250 MHz带宽DPD观测接收机，集成一个12位500 MSPS ADC、一个16,000 × 12 FIFO和一个多模式后端，允许用户通过串行端口检索数据。该滤波器示例是一个DPD应用。

下面是取自一个实际通信系统设计的一些带通滤波器设计规格：

  • 中心频率： 368.4 MHz
  • 带宽： 240 MHz
  • 输入和输出阻抗： 150 Ω
  • 带内纹波： 0.2 dB
  • 插入损耗： 1 dB
  • 带外抑制：30 dB (614.4 MHz)

要完成该示例设计，请执行以下步骤：

  1. 从单端低通滤波器设计开始(参见图18)。
  2. 将单端滤波器变为差分滤波器。源阻抗和负载阻抗保持不变，所有电容并联，所有串联电感减半并放在另一差分路径中(参见图19)。
  3. 用实际值优化元件的理想值(参见图20)。
  4. 对于子系统级仿真，应在输入端增加ADL5201 DGA S-参数文件，并使用压控电压源来模拟滤波器输出端的AD6641 ADC。为将低通滤波器变为带通滤波器，增加两个分流电感：L7与C9并联，L8与C11并联。C12代表AD6641输入电容。R3和R4是放在AD6641输入端的两个负载电阻，用作滤波器的负载。AD6641输入为高阻抗。调谐后的情况参见图21。
  5. 采用理想元件的仿真结构如图16所示。
Figure 16. Filter Transmission Response with Ideal Inductors.
图16. 采用理想电感的滤波器传输响应
  1. 用目标器件(例如Murata LQW18A)的电感S-参数文件代 替所有理想电感。插入损耗比使用理想电感略高。仿真 结果略有变化，如图17所示。
Figure 17. Filter Transmission Response with Murata LQW18A Inductors.
图17. 采用Murata LQW18A电感的滤波器传输响应
Figure 18. Single-Ended Low-Pass Filter.
图18. 单端低通滤波器
Figure 19. Differential Low-Pass Filter with Ideal Components.
图19. 采用理想元件的差分低通滤波器
Figure 20. Differential Low-Pass Filter with Real World Value.
图20. 采用实际值的差分低通滤波器
Figure 21. Differential Band-Pass Filter.
图21. 差分带通滤波器

差分滤波器布局考虑

成对差分走线的长度须相同。此规则源自这一事实：差分接收器检测负信号和正信号在哪里同时跨过彼此，即交越点。因此，信号须同时到达接收器才能正常工作。

差分对内的走线布线须彼此靠近，如果一对中的相邻线路之间的距离大于电介质厚度的2倍，则其间的耦合会很小。此规则也是基于差分信号相等但相反这一事实，如果外部噪声同等地干扰两个信号，则其影响会互相抵消。同样，如果走线并排布线，则差分信号在相邻导线中引起的任何干扰噪声都会彼此抵消。

同一差分对内的走线间距在全长范围内须保持不变。如果差分走线彼此靠近布线，则会影响总阻抗。如果此间距在驱动器与接收器之间变化不定，则一路上会存在阻抗不匹配，导致反射。

差分对之间的间距应较宽，以使其间的串扰最小。

如果在同一层上使用铜填充，应加大从差分走线到铜填充之间的间隙。推荐最小间隙为走线到铜填充的走线宽度的3倍。

在靠近差分对内偏斜源处引入少量弯弯曲曲的校正，从而降低这种偏斜(参见图22)。

Figure 22. Using Meandering Corrections.
图22. 使用弯曲校正

差分对布线时，应避免急转弯(90°)(参见图23)。

Figure 23. Avoid 90° Bends.
图23. 避免90°弯曲

差分对布线时，应使用对称布线(参见图25)。

若需要测试点，应避免引入走线分支，而且测试点应对称放置(参见图24)。

Figure 24. Avoiding Trace Stubs.
图24. 避免走线分支
Figure 25. Symmetric Routing Guidelines.
图25. 对称布线指南

考虑降低对滤波器元件值的要求，减少印刷电路板(PCB)上的调谐工作量；寄生电容和电感应尽可能小。与滤波器设计中的电感设计值相比，寄生电感可能微不足道。寄生电容对差分IF滤波器更为重要。IF滤波器设计中的电容只有几pF，如果寄生电容达到数十分之一pF，滤波器响应就会受到相当大的影响。为了避免寄生电容影响，一个良好的做法是避免差分布线区域和电源扼流圈下有任何接地或电源层。

ADI公司接收器参考设计板(参见图26)提供了差分滤波器PCB布局的一个示例。图26显示ADL5201和AD6649之间有一个五阶滤波器。AD6649是一款14位250 MHz流水线式ADC，具有非常好的SNR性能。

Figure 26. Example of Differential Circuit PCB Layout Design.
图26. 差分电路PCB布局设计示例

参考文献

Chris Bowick， RF电路设计，Newnes，1997年。

Carlos Calvo，“通信系统设计的差分信号优势” ，Analog Devices, Inc.