製品モデル
3
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利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.G)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

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製品の詳細

  • 対称的な超高速乗算器
    • 関数 VW = α × (VX × VY)/1 V + VZ
  • 独特な設計によりXとYが完全に対称
    • XとYの振幅/時間応答は同等
  • 調整可能なゲイン・スケーリング、α
  • DC結合、3 dB 帯域幅: 2 GHz
  • 完全差動入力シングルエンドも可能
  • 低ノイズ、優れた直線性
  • 高精度、温度に対して安定したゲイン・スケーリング
  • 単電源動作: 130 mAで4.5 V~5.5 V
  • 低電流パワーダウン・モード
  • 16ピン LFCSP
ADL5391
乗算器、DC~2.0 GHz
ADL5391 Functional Block Diagram ADL5391 Pin Configuration
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サポート

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ドキュメント

データシート 1

評価用設計ファイル 1

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ツールおよびシミュレーション

Sパラメータ 1

ADIsimRF

ADIsimRFは使いやすいRFシグナル・チェーン計算ツールです。最大50段までのシグナル・チェーンについて、カスケード・ゲイン、ノイズ、歪み、消費電力を計算し、プロット、エクスポートが可能です。ADIsimRFには、アナログ・デバイセズのRFおよびミックスド・シグナル部品のデバイス・モデルの広範なデータ・ベースも含まれています。

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ADIsimPLL™

ADIsimPLLは、アナログ・デバイセズの新しい高性能PLL製品の迅速で信頼性の高い評価を可能にします。これは、現在利用できる最も包括的なPLLシンセサイザ設計およびシミュレーション・ツールです。実施されるシミュレーションには、PLL性能に影響を与える重要な非線形効果がすべて含まれます。ADIsimPLLは、設計プロセスから1回以上の反復作業を削除し、設計から市場投入までの時間を短縮します。

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評価用キット

EVAL-ADL5391

ADL5391 Evaluation Board

製品詳細

The ADL5391-EVALZ is a fully populated, 4-layer, FR4-based evaluation board designed to allow easy evaluation of all features of the ADL5391. Signal inputs and signal output SMA connections with single ended setups are featured. There is an option of full differential signaling on all signal inputs and output at card edge. Access to the +5 V/135 mA supply is achieved with clip leads to the VPOS and COMM testpoints; it has a range from +4.5 to +5.5 V.

EVAL-ADL5391
ADL5391 Evaluation Board

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