DS2156

T1/E1/J1シングルチップトランシーバ、TDM/UTOPIA IIインタフェース

業界初、ATMアプリケーション用、T1/E1/J1トランシーバ

データシート (Rev. 3)
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
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製品の詳細

  • 完全なT1/DS1/ISDN-PRI/J1トランシーバ機能
  • 完全なE1 (CEPT) PCM-30/ISDN-PRIトランシーバ機能
  • ユーザが選択可能なTDMまたはUTOPIA IIバスインタフェース
  • クロック/データリカバリと波形整形のための短距離と長距離ラインインタフェース
  • 光I/F用CMIコーダ/デコーダ
  • 水晶振動子不要のジッタアッテネータ
  • 完全に独立の送信機能と受信機能
  • デュアルHDLCコントローラ
  • プログラマブルBERT発生器と検出器
  • 75Ω/100Ω/120Ω T1とE1インタフェースに対し、内部ソフトウェアにより選択可能な送受信側終端抵抗器
  • 最大16.384MHzの非同期バックプレーンに接続するデュアル2フレームのエラスティックストアスリップバッファ
  • リカバされたネットワーククロックに従って合成された16.384MHz、8.192MHz、4.096MHz、または2.048MHzのクロック出力
  • フルデータシートに列挙のその他の特長
    • DS2156
    T1/E1/J1シングルチップトランシーバ、TDM/UTOPIA IIインタフェース
    DS2156、DS2156L、DS2156LN：ブロックダイアグラム
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    ドキュメント

    データシート 2

    信頼性データ 1

    アプリケーション・ノート 1

    デザイン・ノート 7

    技術記事 7

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    ハードウェア・エコシステム

    製品モデル 製品ライフサイクル 詳細
    Product 4
    DS21352
    		新規設計には非推奨 3.3V DS21352および5V DS21552 T1シングルチップトランシーバ
    DS21354
    		新規設計には非推奨 3.3V/5V E1シングルチップトランシーバ(SCT)
    DS21552
    		新規設計には非推奨 3.3V DS21352および5V DS21552 T1シングルチップトランシーバ
    DS21554
    		新規設計には非推奨 3.3V/5V E1シングルチップトランシーバ(SCT)
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    IBISモデル 1

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