ADSP-21591

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800 MHz 双 SHARC+® DSP，带有两个 640KB L1、1024KB 共享 L2 SRAM、400 球 FCBGA 封装

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产品详情

SHARC+ Core 基础设施
  • 800MHz（最大值） 内核时钟频率
  • 两个 640KB  片内 1 级 (L1) SRAM 存储器（具有奇偶校验功能）可增强低延迟性能
  • 32 位、40 位和 64 位浮点支持
  • 32 位固定点
  • 对字节、短字、字、长字寻址
存储器
  • 1024 KB 片内 2 级(L2) SRAM（具有 ECC 保护功能）- 在许多用例中不再需要外部存储器
  • 3 级 (L3) 接口已针对低系统功耗进行优化，可为 DDR3（支持以 1.35 V 工作的 DDR3L 套件）提供 16 位接口
16 位 DDR/DDR3L 存储器控制器
  • 针对 DDR3L 的 1.35V 支持
高级硬件加速器
  • 增强的 FIR/IIR 加速引擎以内核时钟频率运行，以增加处理能力
  • 具有 OTP 的安全加密引擎
强大的直接存储访问系统

创新型数字音频接口 (DAI) 包括：
  • 具有时分复用和 I2S 模式的 8x 完整 SPORT 接口
  • 2x S/PDIF Rx/Tx、8 个 ASRC 对
  • 8x 精密时钟发生器
  • 2x4 通道 PDM 麦克风输入
  • 28 个缓冲区
其他外设连接/接口：
  • 2x 四路 SPI、1x 八路 SPI
  • MLB 3 引脚
  • 6x I2C、3x UART
  • 2x 链路口
  • 16x 通用定时器、1x 通用计数器
  • 3x 监控定时器
  • 4 通道 12 位管理 ADC
  • 40 个 GPIO 引脚、28 个 DAI 引脚
  • 热传感器
封装
  • 17mm x 17mm（0.8mm 间距）400 球 FCBGA 封装
  • 与 ADSP-21569、ADSP-21567 和 ADSP-21566 处理器引脚完全兼容
其他特性
  • 安全和保护
    • 加密硬件加速器
    • 带 IP 保护功能的快速安全引导
  • 增强的 FIR 和 IIR 加速器，运行频率高达 1 GHz
  • AEC-Q100 适用于汽车应用
ADSP-21591
800 MHz 双 SHARC+® DSP，带有两个 640KB L1、1024KB 共享 L2 SRAM、400 球 FCBGA 封装
ADSP-SC594 (Full-Featured Model) Processor Block Diagram
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