VSC7160

1.5Gbpsおよび3.0Gbpsの12-PHYシリアル接続SCSIエッジエキスパンダ

低コストシングルチップSASエッジエキスパンダ

利用上の注意

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本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.G)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

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製品の詳細

  • 12の個別に自己構成するシリアル接続SCSIエッジエキスパンダPHY
  • 任意のPHY間接続(任意のPHYは個別にターゲットまたはイニシエータデバイスに接続可能)
  • 各PHYは個別に1.5Gbpsまたは3.0Gbpsで動作可能
  • PHY速度の自動検出/ネゴシエーション
  • ANSI T10 SAS 1.0および1.1準拠
  • 複数のプログラマブル出力レベル
  • プログラマブルな出力プリエンファシス
  • プログラマブルな入力信号イコライズ
  • 内部STP/SATAブリッジ機能を通じてシリアルATAドライブをサポート(PHY当り1)
  • 複数の動作モード(マスタ、スレーブ、および自動)
  • リンク試験と診断
  • 広範囲のループバックモード
  • ローカル制御およびSMP機能用の組込みv3000エンクロージャ管理プロセッサ(Stanford-I、32ビットRISC CPU)
  • 最大44のレジスタアクセス可能な汎用I/O (GPIO)
  • デュアルマルチマスタI²Cインタフェース(マスタモード動作時にSSC050-01/VSC055を介してGPIO拡張)
  • 16kBユーザデータSRAM内蔵
  • 外部シリアルフラッシュおよびEEPROMサポート
  • JTAGベースのハードウェアCPUデバッグインタフェース
  • マルチレートシリアルUART
  • SMPコマンド/プロトコルをサポート
  • 完全ソフトウェア開発キット(SDK)およびリファレンスアプリケーション
  • 208ピンTQFP
  • 0.18µm TSMC CMOS、6層メタル
  • 5W (typ)、5W (max)
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1.5Gbpsおよび3.0Gbpsの12-PHYシリアル接続SCSIエッジエキスパンダ
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