MAX3877

2.5Gbps、+3.3VクロックおよびデータリタイミングIC、垂直スレッショルド調整付

データシート (Rev. 0)
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
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製品の詳細

  • Exceeds ANSI, ITU, and Bellcore SONET/SDH Specifications
  • Adjustable Input Threshold (±180mV)
  • 10mVp-p to 1.2Vp-p Differential Input Range
  • 540mW Power Dissipation (at +3.3V)
  • Fully Integrated Clock Recovery and Data Retiming
  • Optional Holdover Capability (Using External Reference Clock)
  • 0.003UIRMS Clock Jitter Generation
  • Tolerates >2000 Consecutive Identical Digits
  • Additional 2.488Gbps Input for Diagnostic Loopback Testing
  • Differential PECL or CML Data and Clock Outputs
  • Loss-of-Signal Indicator
  • Loss-of-Lock Indicator
MAX3877
2.5Gbps、+3.3VクロックおよびデータリタイミングIC、垂直スレッショルド調整付
MAX3877、MAX3878：標準動作回路
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